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	<title>Circuitos y Sistemas</title>
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	<pubDate>Thu, 19 Nov 2009 21:21:17 +0000</pubDate>
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		<title>Cursos de Entrenamiento: Programación de FPGAs y Sistemas Embebidos.</title>
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		<pubDate>Thu, 19 Nov 2009 21:05:20 +0000</pubDate>
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		<category><![CDATA[Uncategorized]]></category>

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		<description><![CDATA[Los cursos tiene por objetivo dotar al alumno de técnicas en el manejo de los FPGAs para diseño electrónico de altas prestaciones. El contenido teórico estará acompañado del desarrollo de prácticas usando herramientas software y hardware de Xiilinx, lo que permitirá a los participantes obtener un adecuado soporte para su aprendizaje&#8230;.más
]]></description>
			<content:encoded><![CDATA[<p>Los cursos tiene por objetivo dotar al alumno de técnicas en el manejo de los FPGAs para diseño electrónico de altas prestaciones. El contenido teórico estará acompañado del desarrollo de prácticas usando herramientas software y hardware de Xiilinx, lo que permitirá a los participantes obtener un adecuado soporte para su aprendizaje&#8230;.<a title="Cursos de Entrenamiento" href="http://www.utpl.edu.ec/reddsp/index.php?option=com_content&amp;task=view&amp;id=12&amp;Itemid=43">más</a></p>
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		<title>Centro Académico de Entrenamiento ISTEC-UTPL abre sus puertas</title>
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		<pubDate>Fri, 24 Jul 2009 15:37:21 +0000</pubDate>
		<dc:creator>mfquinonez</dc:creator>
		
		<category><![CDATA[Uncategorized]]></category>

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		<description><![CDATA[

EL Centro Académico de Entrenamiento ISTEC-UTPL abre sus puertas el 24 de agosto con un taller de *Aplicaciones de Procesamiento Digital de Señales para Telecomunicaciones en FPGAs*. Este taller organizado en colaboración con el Centro de Educación Continua de ISTEC (CECi) es el primer paso para crear sinergias dentro de las comunidades científicas de la [...]]]></description>
			<content:encoded><![CDATA[<p class="MsoPlainText"><img src="/Users/huhui/AppData/Local/Temp/moz-screenshot-1.png" alt="" /></p>
<p class="MsoPlainText"><img class="aligncenter size-full wp-image-61" src="http://blogs.utpl.edu.ec/circuitosysistemas/files/2009/07/banner_fpgas_small.gif" alt="banner_fpgas_small" width="480" height="121" /></p>
<p class="MsoPlainText">EL<span> </span>Centro Académico de Entrenamiento ISTEC-UTPL abre sus puertas el 24 de agosto con un taller de *Aplicaciones de Procesamiento Digital de Señales para Telecomunicaciones en FPGAs*. Este taller organizado en colaboración con el Centro de Educación Continua de ISTEC (CECi) es el primer paso para crear sinergias dentro de las comunidades científicas de la región.</p>
<p class="MsoPlainText">Como parte de las actividades de inauguración del Centro ISTEC donará tarjetas Xilinx Spartan-3E a los primeros 20 participantes que se inscriban al curso.</p>
<p class="MsoPlainText">Para mayor información visitar:</p>
<p class="MsoPlainText"><a title="TALLER FPGAS_ISTEC_UTPL" href="http://www.istec.org/ceci/capacitacion/telecom-fpgas/">http://www.istec.org/ceci/capacitacion/telecom-fpgas/<br />
</a></p>
<p class="MsoPlainText">
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		<title>Primer Centro  Académico  de  Entrenamiento  ISTEC ‐ UTPL en Ecuador</title>
		<link>http://blogs.utpl.edu.ec/circuitosysistemas/2009/05/18/campana-forma-parte-de-la-utpl-20/</link>
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		<pubDate>Mon, 18 May 2009 21:28:04 +0000</pubDate>
		<dc:creator>mfquinonez</dc:creator>
		
		<category><![CDATA[Proyecto Blogs]]></category>

		<category><![CDATA[campaña utpl 2.0]]></category>

		<category><![CDATA[utpl]]></category>

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		<description><![CDATA[  
El 30 de abril recibimos la notificación oficial por parte de ISTEC(Ibero-American Science and Technology Education Consortium), de la selección de nuestra Universidad como Centro Académico de Entrenamiento de ISTEC, este es un gran reconocimiento para  nuestra Institución.
El Centro Académico de Entrenamiento ISTEC_UTPL inaugurara sus actividades con la realización del Taller en FPGAs [...]]]></description>
			<content:encoded><![CDATA[<p class="MsoNormal" style="margin-bottom: 0.0001pt;text-align: justify"><!--[if gte mso 9]&gt;  Normal 0   21   false false false  ES X-NONE X-NONE                           &lt;![endif]--><!--[if gte mso 9]&gt;                                                                                                                                            &lt;![endif]--><!--[if gte mso 9]&gt;  Normal 0   21   false false false  ES X-NONE X-NONE                           &lt;![endif]--><!--[if gte mso 9]&gt;                                                                                                                                            &lt;![endif]--> <!--[if gte mso 9]&gt;  Normal 0   21   false false false  ES X-NONE X-NONE                           &lt;![endif]--><!--[if gte mso 9]&gt;                                                                                                                                            &lt;![endif]--> <!--[if gte mso 9]&gt;  Normal 0   21   false false false  ES X-NONE X-NONE                             &lt;![endif]--><!--[if gte mso 9]&gt;                                                                                                                                            &lt;![endif]--></p>
<p class="MsoNormal" style="margin-bottom: 0.0001pt;text-align: justify"><span style="font-size: 10pt">El 30 de abril recibimos la notificación oficial por parte de ISTEC(Ibero-American Science and Technology Education Consortium), de la selección de nuestra Universidad como Centro Académico de Entrenamiento de ISTEC, este es un gran reconocimiento para  nuestra Institución.</span></p>
<p class="MsoNormal" style="margin-bottom: 0.0001pt;text-align: justify"><span style="font-size: 10pt">El Centro Académico de Entrenamiento ISTEC_UTPL inaugurara sus actividades con la realización del Taller en FPGAs en Julio próximo.</span></p>
<p class="MsoNormal" style="margin-bottom: 0.0001pt;text-align: justify"><span style="font-size: 12pt"> </span></p>
<p class="MsoNormal" style="margin-bottom: 0.0001pt;text-align: justify"><span style="font-size: 10pt">A continuación expongo la  notificación oficial enviada al Ing.- Jorge Luis Jaramillo por parte de ISTEC:</span></p>
<p class="MsoNormal" style="margin-bottom: 0.0001pt;text-align: justify"><span style="color: #0000ee"><span><span style="color: #000000"><object type=application/x-shockwave-flash data=https://s3.amazonaws.com:443/slideshare/ssplayer.swf?id=1465235&amp;doc=utlpselectionletter-4-090520111833-phpapp02&amp;type=d width=425 height=348><param name=movie value=https://s3.amazonaws.com:443/slideshare/ssplayer.swf?id=1465235&amp;doc=utlpselectionletter-4-090520111833-phpapp02&amp;type=d /></object><br/>By <a href='http://ringofblogs.com'>rob</a></span></span></span></p>
<p class="MsoNormal" style="margin-bottom: 0.0001pt;text-align: justify"><span style="font-size: 10pt;font-family: &quot;Arial&quot;,&quot;sans-serif&amp;quot"> </span> <code> </code></p>
]]></content:encoded>
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		<title>COMUNICACIÒN SERIAL MATLAB_PROTEUS_AVR_ VIRTUAL SERIAL PORT</title>
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		<pubDate>Mon, 11 May 2009 21:55:50 +0000</pubDate>
		<dc:creator>mfquinonez</dc:creator>
		
		<category><![CDATA[Uncategorized]]></category>

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		<description><![CDATA[Descarga completa de proyecto:
COMUNICACIÒN SERIAL_MATLAB_PROTEUS_AVR
]]></description>
			<content:encoded><![CDATA[<a href="http://blogs.utpl.edu.ec/circuitosysistemas/2009/05/11/proyectos/"><em>Click here to view the embedded video.</em></a>
<p>Descarga completa de proyecto:</p>
<p><a title="COMUNICACION SERIAL MATLAB_PROTEUS_AVR" href="http://www.4shared.com/file/115139548/c084f248/COMUNICACIN_SERIAL_MATLAB_PROTEUS_AVR.html" target="_self">COMUNICACIÒN SERIAL_MATLAB_PROTEUS_AVR</a><span id="more-6"></span></p>
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